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专利择要显示,本公开是关于一种基于关键路径的时钟树综合处理方法、装置、设备及介质。所述方法包括:确定芯片中的关键路径;个中,所述芯片包括多个模块以及多个IP;基于所述关键路径,调度所述芯片中的所述模块和/或所述IP的位置,得到更新后的芯片布局;基于所述关键路径以及所述芯片布局,天生时钟树,所述时钟树包括时钟源以及多个节点;基于预设时钟偏斜进行时钟树综合处理,以使所述关键路径的时钟偏斜减小。该方法在进行时钟树综合处理时,考虑芯片中的关键路径,使关键路径的时钟偏斜减小,确保在繁芜芯片中的时钟树有较小的时钟树延迟、时钟偏斜,有均衡的时钟树,从而确保芯片物理设计中的时序同等,达到减小芯片面积、降落芯片功耗的目的。
本文源自金融界


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