SN74LVC16245ADGGR/74LVC16245ADGG/AIP74LVC16245最新中文资料_芯片_逻辑

该设备可用作两个 8 位收发器或一个 16 位收发器。
输入可由 3.3V 或 5V 器件驱动。
失落能时，最高可将 5.5V 施加至输出。
这些功能使得芯片可以在 3.3V 和 5V 稠浊运用中利用。

数据输入具有 AIP74LVCH16245 总线保持功能，因此无需外部上拉电阻来保持未利用的输入。

其紧张特点如下：

● 5V 耐压输入/输出，用于 5V 逻辑接口

● 宽电源电压范围： 1.2V～3.6V

● CMOS 低功耗

● 多字节直通标准引脚分配架构

● 低电感多个电源和接地引脚，可将噪声和接地反弹降至最低

● 与 TTL 电平直接接口

● VCC=0V 时为高阻抗

● 所有数据输入均具有总线保持（仅限 AIP74LVCH16245）

● 事情环境温度范围为-40℃～+105℃

● 封装形式： TSSOP48

● ESD 保护：

人体模式（EIA/JESD22－A114－A） 超过2000V

机器模式（EIA/JESD22－A115－A） 超过200V

根本参数

逻辑电路的归属系列: 74LVC

类型: 收发器,非反相

电源电压: 1.2V~3.6V

输入类型: -

输出类型: 三态

低电平输出电流(IOL): 24mA

高电平输出电流(IOH): 24mA

逻辑电平-高: 1.7V~2V

逻辑电平-低: 0.7V~0.8V

静态电流(最大值): 80uA

不同 V,最大 CL 时的最大传播延迟: 6.0ns@3.3V,50pF

事情温度: -40℃~+105℃

互换参数

功能框图

逻辑符号

IEC 逻辑符号

总线保持电路

引脚排列图

引脚解释

功能表

本文引用地址：http://www.eepw.com.cn/article/249187.htm

　　关键词 逻辑剖析仪;USB接口;FPGA;FIFO传输

　　逻辑剖析仪是数字设计验证与调试过程中运用广泛的工具，其能够考验数字电路是否正常事情，并帮助用户查找并打消故障。
每次可捕获并显示多个旗子暗记，剖析这些旗子暗记的韶光关系和逻辑关系。
根据硬件设备设计上的差异，目前逻辑剖析仪大致可分为独立式和需结合电脑的卡式虚拟逻辑剖析仪。
独立式逻辑剖析仪性能精良，但价格昂贵，一样平常用户较少利用。
而本项目所实现的便携式逻辑剖析仪，以较低的本钱供应了相应的性能，虽然性能有所低落，但完备可以知足一样平常的逻辑旗子暗记剖析，并且使本钱大幅度低落，仪器体积较小，便于携带，适宜普通用户的利用。

　　1 系统总体设计方案

　　本逻辑剖析仪可实现16通道逻辑剖析，输入旗子暗记可以是仿照旗子暗记或数字旗子暗记;可丈量宽范围输入电平，支持1.8～5 V电平采样;采取芯片CY7C68013A作为主控芯片，通过USB 2.0将其与电脑连接传输数据信息，利用FPGA实现高采样速率，每通道都支持12 Mbit·s-1高速采样;被采样的旗子暗记按顺序存储在存储器中。
采样信息以“前辈先出”的原则组织在存储器中，得到显示命令后，按照先后顺序逐一读出信息，按设定的显示办法进行被丈量的显示。
这样就可以在软件界面不雅观测到所须要的数字波形，并可设置触发办法，显示所须要的波形。

　　本项目采取CY7C68013A作为USB采集主控芯片，利用XC6SLX9作为数据通道的选择器件，选择输入到CY7C68013A的数据是来源于数字旗子暗记还是仿照旗子暗记经ADC模块之后的数字旗子暗记。
由于该逻辑剖析仪为USB连接，故此在USB连接端口上加入ESD芯片。
并在板上增加16 kB的EEPR0M来作为CY7C68013A的程序存储器。
图1为逻辑剖析仪的基本组成框图。

　　项目所采取的CY7C68013A芯片为低功耗芯片，该芯片内核为增强型51核，内部有16 kB程序数据区，该芯片的主频为48 MHz，并且知足480 Mbit·s-1高速传输协议标准，符合USB2.0规范，并向下兼容USB1.1规范，基本能知足该项目的数据哀求。

　　XC6SLX9为Xilinx公司生产的Spartan6系列的FPGA，具有9 152个逻辑单元。
Spartan6系列产品基于公认的低功耗45 nm、9-金属铜层、双栅极氧化层工艺技能，供应了高等功耗管理技能、150 000个逻辑单元、集成式PCI Express模块、高等存储器支持、250 MHz DSP Slice和3.125Gbit·s-1低功耗收发器。
该项目所选用的芯片为144脚封装的芯片，所拥有的IO能够知够数据高速通讯的哀求。

　　在USB连接端加入ESD芯片能够更好的防止静电滋扰，使得该逻辑剖析仪利用起来更加安全可靠。

　　2 硬件电路设计

　　系统硬件设计紧张包括与打算机接口部分和数据采集部分。
通过FPGA完成触发设置，高速捕获数据和缓存的掌握，利用CY7C68013A作为USB主控芯片完成与上位机的通信，将数据发送到打算机上位机上，并且吸收上位机发送回的触发掌握字及其他掌握信息，与FPGA协同事情。
电路分为USB主控模块，FPGA从控模块，数据采集模块，数据缓存模块，电源供电模块这5大模块。

　　2.1 USB主控模块

　　USB主控芯片选择的型号是CY7C68013A-56PVXC，该芯片集成USB 2.0收发器、增强型8051微处理器，适用性、外不雅观和功能均与FX2兼容。
具有16 kB片上代码/数据RAM，4个可编程的BULK/INTERRUPT/ISOCHRONOUS端点，8位或16位外部数据接口，且它的可编程接口可与大多数并行接口直接连接、由可编程波形描述符和配置寄存器定义波形、支持多个RDY和CTL输出，该芯片的事情电压为3.3 V，容限电压为5 V，集成I2C掌握器。

　　USB主控芯片接24 MHz晶振，PB口吸收来自于FPGA的FIFO数据，15脚和16脚接USB_B型接口的D+和D-，用于向上位机发送数据，同时吸收上位机掌握信息。
I2C总线上接一AT24C64(EEPROM)用做USB程序存储器。
别的的引脚用于读取FPGA确当前状态和发送触发等信息给FPGA，以确定何时进行读取数据。

　　2.2 FPGA从控模块

　　FPGA选用Xilinx Spartan-6系列的XC6SLX9-4TQ144C，接100 MHz的晶振。
芯片中设定的16个IO引脚吸收来自于74ALVC164245的16位三态总线收发器的数据，FPGA.VS[2：0]三引脚全部拉高，配置为快速读写模式，可以提高采样速率。
Spartan-6系列FPGA中，配置模式引脚为M[1：0]，不像Spartan-3系列有3个配置引脚M[2：0]，这里配置为“10”，即主串模式。
此时INIT_B引脚须要拉高，防止芯片配置完成后又进入芯片初始化，DONE引脚也要拉高。
配置JTAG接口用于下载程序。
别的引脚用于连接两片4 MB的RAM，用于将采集到的数据先缓存进RAM中。

　　2.3 数据采集模块

　　数据采集芯片采取SN74LVC16245ADGGR，是一个16位三态总线收发器。
当OE引脚接高电平时，输出为高阻态。
当OE为低时，如果DIR引脚为低电平，则数据从B口传向A口，DIR为高电平时，数据从A口传向B口。
图中用B口采集外部数据，并且外接1MΩ电阻以提高输入阻抗。
因此DIR和OE引脚接上拉电阻，默认上电从A到B输出无效。

　　2.4 数据缓存模块

　　扩展RAM芯片采取的是256×16 kbit高速异步CMOS静态RAM芯片IS61LV25616。
直接将nCE，nLB，nUB这3个引脚接CND，可以方便读写数据。
读写掌握旗子暗记nOE和nWE与FPGA相连，用于掌握将外部采集数据读入RAM缓存或将数据读出通过USB掌握芯片传送到上位机中。
其掌握逻辑为：nWE为高，nOE为低时，从RAM中读出数据;nWE为低时，写入数据到RAM中。

　　2.5 电源供电模块

　　供电芯片选择的是LM1117系列稳压芯片，有3.3 V和1.2 V。
电源输入采取的是耳机式插孔电源，输入为5 V，1 A。
如果用USB供电，由于USB最大输出电流为500 mA，因此在高速采样时可能电流不足，因此选用外接电源。

　　3 逻辑剖析仪的设计验证

　　逻辑剖析仪的上位机软件采取Saleae Logic1.1.16。
装上软件和驱动之后，还要给USB主控芯片CY7C68013A烧写固件程序，Saleae供应了一个iic文件，用于和Saleae Logic上位机软件进行通信。
FPGA的逻辑代码包括USB协同掌握部分，SRAM缓存部分，触发设置选择部分，FIFO数据采集部分，综合编译后天生bit文件，用Xilinx Impact软件烧写进FPGA的Flash中，FPGA就可以自动完成上电配置过程，无需再下载。
图2为测试截图。
可以看出，软件左上端可以选择采样速率和深度，左端可以进行触发设置，设置好后，点击Start后就可以采集数据，右端可以显示详细的丈量信息。

　　4 结束语

　　设计的便携式逻辑剖析仪本钱低廉，可以实现16通道的数据采样，触发设置。
可以实现3通道90 MHz最高采样率，6通道50 MHz最高采样率，9通道30MHz最高采样率以及16通道12 MHz最高采样率。
软件操作界面大略易懂，随意马虎上手利用，可以知足一样平常的科研和传授教化的哀求。

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