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AD9361BBCZ/ADI/亚德诺/代理现货库存/射频收发器 /深圳太航半导体_暗记_旗子

雨夜梧桐 2024-11-08 06:58:57 0

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型号:AD9361BBCZ品牌:ADI/亚德诺数量;3080pcs库存特性resrf 2 × 2收发器,集成12位dac和ADCsTX频段:47 MHz至6.0 GHzRX频段:70 MHz至6.0 ghz支持TDD和FDD操作可调信道带宽:<200 kHz至56 MHz双吸收器:6个差分或12个单端输入优胜的吸收灵敏度,800 MHz时噪声系数为2 dB LORX增益掌握实时监测和掌握旗子暗记手动增益独立自动增益掌握双发射器:4差分输出高线性宽带发射机tx EVM:≤−40 dBTX噪声:≤−157 dBm/Hz噪声floorTX监视器:≥66 dB动态范围1db精度集身分数- n合成器2.4 Hz最大本地振荡器(LO)步长多芯片同步cmos /LVDS数字接口运用点对点通信系统飞蜂窝/ piccell /微蜂窝基站通用无线电系统功能框图图1。
AD9361是一款高性能、高度集成的射频(RF)敏捷收发器™,专为3G和4g基站运用而设计。
其可编程性和宽带性能使其成为广泛收发器运用的空想选择。
该器件将射频前端与灵巧的稠浊旗子暗记基带部分和集成频率合成器结合在一起,通过为处理器供应可配置的数字接口来简化设计。
AD9361吸收机LO事情范围为70 MHz至6.0 GHz,发射机LO事情范围为47 MHz至6.0 GHz,覆盖大多数授权和未授权频段。
支持200khz ~ 56mhz的信道带宽。
两个独立的直接转换吸收用具有一流的噪声系数和线性度。
每个吸收(RX)子系统包括独立的自动增益掌握(AGC)、直流偏置校正、正交校正和数字滤波,从而肃清了在数字基带中对这些功能的需求。
ad9361还具有灵巧的手动增益模式,可以外部掌握。
每个通道的两个高动态范围模数转换器(adc)将吸收到的I和Q旗子暗记数字化,并通过可配置的抽取滤波器和128分接有限脉冲相应(FIR)滤波器,以适当的采样率产生12位输出旗子暗记。
发射机采取直接转换架构,实现高调制精度和超低噪声。
该发射机设计产生同类最佳的TX偏差矢量幅度(EVM) < - 40 dB,为外部功率放大器(PA)选择供应了显著的系统余量。
板载传输(TX)功率监视器可以用作功率检测器,实现高精度的TX功率丈量。
完备集成的锁相环(pll)为所有吸收和发射通道供应低功率分数n频率合成。
频分双工(FDD)系统哀求的信道隔离被集成到设计中。
所有VCO和环路滤波器组件集成。
AD9361的核心可以直接从1.3 v稳压器供电。
该IC通过一个标准的4线串行端口和四个实时输入/输出掌握引脚进行掌握。
包括全面的断电模式,以只管即便减少正常利用期间的功耗。
AD9361封装在10mm × 10mm、144球芯片级封装球栅阵列(CSP_BGA)中。

绝对最大额定值稳定11。
参数额定值vddx至VSSx−0.3 V至+1.4 VVDD_INTERFACE至VSSx−0.3 V至+3.0 VVDD_GPO至VSSx−0.3 V至VDD_INTERFACE + 0.3 V VLogic输入输出至VSSx−0.3 V至VDD_INTERFACE + 0.3 V输入电流到任意引脚除电源±10 mARF输入(峰值功率)2.5 dBmTX监视器输入功率(峰值功率)9 dbmpp封装功耗(TJMAX−TA)/θ最大连接温度(TJMAX)110°C事情温度范围−40°C至+85°C存储温度范围−65°C至+150°C应力即是或高于下面列出的绝对最大额定值可能对产品造成永久性破坏。
这只是一个压力评级;不暗示产品在上述或本解释书操作部分所述的任何其他条件下的功能操作。
永劫光超出最大运行条件的运行可能会影响产品的可靠性。
回流配置文件AD9361回流配置文件符合无铅器件的JEDECJESD20标准。
最高回流温度为260℃。

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AD9361是一款高度集成的射频(RF)收发器,能够配置用于广泛的运用。
该器件集成了所有射频、稠浊旗子暗记和数字块,以在单个器件中供应所有收发器功能。
可编程性许可该宽带收发器适应多种通信标准,包括频分双工(FDD)和时分双工(TDD)系统。
这种可编程性还许可该设备利用单个12位并行数据端口,双12位并行数据端口或12位低压差分旗子暗记(LVDS)接口连接到各种基带处理器(bbp)。
AD9361还供应自校准和自动增益掌握(AGC)系统,以在不同温度和输入旗子暗记条件下保持高性能水平。
此外,该设备还包括几种测试模式,许可系统设计职员插入测试腔调并创建内部环回模式,设计职员可以利用这些模式在原型设计期间调试他们的设计并优化特定运用的无线电配置。
receiverreceiver部分包含吸收射频旗子暗记并将其转换为BBP可用的数字数据所需的所有块。
有两个独立掌握的通道,可以吸收来自不同来源的旗子暗记,许可设备用于多输入,多输出(MIMO)系统,同时共享一个共同的频率合成器。
每个通道有三个输入,可以复用到旗子暗记链,使AD9361适用于具有多个天线输入的分集系统。
吸收器是一个直接转换系统,包含一个低噪声放大器(LNA),然后是匹配的同相(I)和正交(Q)放大器,混频器和带整形滤波器,将吸收到的旗子暗记向下转换到基带进行数字化。
外部lna也可以连接到设备,许可设计职员灵巧地定制吸收器前端,以知足他们的特定运用。
增益掌握是通过遵照预编程的增益指数映射来实现的,该映射在每个级别的最佳性能块之间分配增益。
这可以通过在快速或慢速模式下启用内部AGC或通过利用手动掌握来实现,许可BBP根据须要进行增益调度。
此外,每个通道包含独立的rssi丈量能力,直流偏置跟踪和自校准所需的所有电路。
吸收器包括12位,Σ-Δ adc和可调采样器,从吸收的旗子暗记产生数据流。
数字化旗子暗记可以通过一系列抽取滤波器和具有额外抽取设置的完备可编程128分接FIR滤波器进一步调节。
每个数字滤波器块的采样率可以通过改变抽取因子来产生所需的输出数据率来调节。
发射器发射器部分由两个相同且独立掌握的通道组成,供应实现直接转换系统所需的所有数字处理,稠浊旗子暗记和RF块,同时共享一个公共频率合成器。
从BBP吸收的数字数据通过一个完备可编程的128分接FIR滤波器与插值选项。
FIR输出被发送到一系列插值滤波器,这些滤波器在到达DAC之前供应额外的滤波和数据速率插值。
每个12位DAC具有可调采样率。
两个通道都被馈送到射频模块进行上转换。
当转换为基带仿照旗子暗记时,对I和Q旗子暗记进行滤波以去除采样伪影并馈送到上变频混频器。
在这一点上,I和Q旗子暗记被重组并在载波频率上调制以传输到输出级。
合并后的旗子暗记还通过供应额外频带整形的仿照滤波器,然后旗子暗记传输到输出放大器。
每个传输通道供应了一个广泛的衰减调度范围与细粒度,以帮助设计职员优化信噪比(SNR)。
自校准电路内置于每个传输通道,以供应自动实时调度。
发射器块还为每个通道供应一个TX监视器块。
这个壅塞监控发射器输出,并通过未利用的吸收器通道将其路由回BBP进行旗子暗记监控。
当吸收器空闲时,tx监视器块仅在TDD模式下可用。
时钟输入选项AD9361利用参考时钟事情,参考时钟可以由两个不同的源供应。
第一种选择是在XTALP和XTALN引脚之间连接一个频率在19 MHz和50 MHz之间的专用晶体。
第二种选择是将外部振荡器或时钟分配设备(如AD9548)连接到XTALN引脚(XTALP引脚保持未连接)。
如果利用外部振荡器,频率可以在10mhz到80mhz之间变革。
AD9361包含两个相同的合成器,用于为RF旗子暗记路径天生所需的LO旗子暗记:一个用于吸收器,一个用于发射器。
锁相环(PLL)合成器是分数n设计,包含完备集成的电压掌握振荡器(vco)和环路滤波器。
在tdd操作,合成器打开和关闭适当的theRX和TX帧。
在FDD模式下,可以同时激活TX PLL和RX PLL。
这些锁相环不须要外部元件。
BB锁相环AD9361还包含一个基带锁相环合成器,用于天生所有基带干系时钟旗子暗记。
这些包括ADC和DAC采样时钟、DATA_CLK旗子暗记(拜会数字数据接口部分)和所有数据帧旗子暗记。
该锁相环根据系统的数据速率和采样率哀求从700 MHz编程到1400 MHz。
数字数据接口AD9361数据接口利用并行数据接口(P0和P1)在设备和BBP之间传输数据。
数据端口可以配置为单端CMOS格式或差分vds格式。
这两种格式都可以配置在多种安排中,以匹配系统对数据排序和数据端口连接的哀求。
这些安排包括单端口数据总线、双端口数据总线、单数据速率、双数据速率和各种数据排序组合,以便在适当的韶光跨总线传输来自不同通道的数据。
总线传输利用大略的硬件手传信令进行掌握。
这两个端口可以事情在双向(TDD)模式或全双工(FDD)模式,个中一半用于发送数据,一半用于吸收数据。
接口也可以配置为只利用一个数据端口,用于不须要高数据速率和更喜好利用较少接口引脚的运用程序。
DATA_CLK SignalRX数据供应BBP在吸收数据时可以利用的DATA_CLK旗子暗记。
DATA_CLK可以设置为供应单数据速率(SDR)定时,个中数据在每个上升时钟沿上采样,或者可以设置为供应双数据速率(DDR)定时,个中数据在上升沿和低落沿上捕获。
此计时适用于利用单个端口或两个端口的操作。
FB_CLK旗子暗记对付传输数据,接口利用FB_CLK旗子暗记作为定时参考。
FB_CLK许可源同步定时与上升沿捕获突发掌握旗子暗记和上升沿(SDR模式)或边缘捕获(DDR模式)发送旗子暗记突发。
FB_CLK旗子暗记必须与DATA_CLK具有相同的频率和占空比。
RX_FRAME旗子暗记每当吸收器输出有效数据时,设备就会天生RX_FRAME输出旗子暗记。
这个旗子暗记有两种模式:电平模式(只要数据有效,RX_FRAME就保持高电平)和脉冲模式(RX_FRAME脉冲占空比为50%)。
类似地,BBP必须供应一个TX_FRAME旗子暗记,该旗子暗记指示有效数据传输的开始与上升沿。
与RX_FRAME类似,TX_FRAME旗子暗记可以在全体突发期间保持高电平,也可以以50%的占空比脉冲。
使能状态机AD9361收发器包括一个使能状态机(ENSM),许可实时掌握设备确当前状态。
在正常事情期间,该设备可以放置在几种不同的状态,包括•等待省电,合成器禁用•就寝等待与所有时钟/BB锁相环禁用•TX-TX旗子暗记链启用•RX - RX旗子暗记链启用•FDD-TX和RX旗子暗记链启用•警报合成器启用ENSM有两种可能的掌握方法:SPI掌握和引脚掌握。
SPI掌握模式在SPI掌握模式下,通过写入SPI寄存器来异步掌握ENSM,以将当前状态推进到下一个状态。
SPI掌握被认为是与data_clk异步的,由于SPI_CLK可以从不同的时钟引用派生,并且仍旧可以正常事情。
当不须要对合成器进行实时掌握时,建议利用SPI controlENSM方法。
只要BBIC能够准确地实行定时SPI写入,SPI掌握就可以用于实时掌握。
引脚掌握模式在引脚掌握模式下,enable引脚和TXNRX引脚的使能功能许可对当前状态进行实时掌握。
ENSM许可TDD或FDD操作取决于相应SPI寄存器的配置。
如果bbic具有可以实时掌握的额外掌握输出,则建议利用ENABLEand TXNRX引脚掌握方法,许可大略的2线接口来掌握设备的状态。
为了将ENSM确当前状态推进到下一个状态,enable引脚的使能功能可以由脉冲(内部检测边缘)或电平驱动。
当利用脉冲时,它必须具有一个FB_CLK周期的最小脉冲宽度。
在电平模式下,ENABLE和TXNRXpins也由AD9361进行边缘检测,并且必须知足一个FB_CLK周期的相同最小脉冲宽度哀求。

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规格

产品属性

属性值

选择属性

制造商:

Analog Devices Inc.

产品种类:

射频收发器

RoHS:

详细信息

类型:

LTE, WiMAX

频率范围:

70 MHz to 6 GHz

最大数据速率:

-

调制格式:

TDD, FDD

电源电压-最小:

1.267 V

电源电压-最大:

1.33 V

输出功率:

8 dBm

最小事情温度:

- 40 C

最大事情温度:

+ 85 C

接口类型:

3-Wire, 4-Wire, SPI

封装 / 箱体:

BGA-144

封装:

Tray

牌号:

Analog Devices

湿度敏感性:

Yes

安装风格:

SMD/SMT

吸收机数量:

2

发送机数量:

2

产品类型:

RF Transceiver

灵敏度:

2.5 dB

系列:

AD9361

工厂包装数量:

184

子种别:

Wireless & RF Integrated Circuits

技能:

Si

单位重量:

840 mg

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