1、当 TTL电路驱动COMS电路时，如果 TTL 电路输出的高电平低于 COMS 电路的最低高电平（一样平常为 3。5V），这时就须要在 TTL 的输出端接上拉电阻，以提高输出高电平的值。
2、OC 门电路“必须加上拉电阻，才能利用”。
3、为加大输出引脚的驱动能力，有的单片机管脚上也常利用上拉电阻。
4、在 COMS 芯片上，为了防止静电造成破坏，不用的管脚不能悬空，一样平常接上拉电阻产生降落输入阻抗，供应泄荷通路。
5、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入旗子暗记的噪声容限增强抗滋扰能力。
6、提高总线的抗电磁滋扰能力。管脚悬空就比较随意马虎接管外界的电磁滋扰。
7、长线传输中电阻不匹配随意马虎引起反射波滋扰，加高下拉电阻是电阻匹配，有效的抑制反射波滋扰。
8、在数字电路中不用的输入脚都要接固定电平，通过 1k 电阻接高电平或接地。
上拉电阻阻值选择原则
1、从节约功耗及芯片的灌电流能力考虑应该足够大；电阻大，电流小。
2、从确保足够的驱动电流考虑应该足够小；电阻小，电流大。
3、对付高速电路，过大的上拉电阻可能边沿变平缓。综合考虑
以上三点，常日在 1k 到 10k 之间选取。对下拉电阻也有类似道理。
对上拉电阻和下拉电阻的选择应“结合开关管特性和下级电路的输入特性进行设定，紧张须要考虑以下几个成分”：
1。驱动能力与功耗的平衡。以上拉电阻为例，一样平常地说，上拉电阻越小，驱动能力越强，但功耗越大，设计是应把稳两者之间的均衡。
2。下级电路的驱动需求。同样以上拉电阻为例，当输出高电平时，开关管断开，上拉电阻应适当选择以能够向下级电路供应足够的电流。
3。高低电平的设定。不同电路的高低电平的门槛电平会有不同，电阻应适当设定以确保能输出精确的电平。以上拉电阻为例，当输出低电平时，开关管导通，上拉电阻和开关管导通电阻分压值应确保在零电平门槛之下。
4。频率特性。以上拉电阻为例，上拉电阻和开关管漏源级之间的电容和下级电路之间的输入电容会形成“RC 延迟”，电阻越大，延迟越大。上拉电阻的设定应考虑电路在这方面的需求。
下拉电阻的设定的原则和上拉电阻是一样的。
OC 门输出高电平时是一个高阻态，其上拉电流要由上拉电阻来供应，设输入端每端口不大于 100uA，设输出口驱动电流约 500uA，标准事情电压是 5V，输入口的高低电平门限为 0.8V(低于此值为低电平)；2V(高电平门限值)。
选上拉电阻时：500uA x 8.4K= 4.2 即选大于 8.4K 时输出端能下拉至 0.8V 以下，此为最小阻值，再小就拉不下来了。如果输出口驱动电流较大，则阻值可减小，担保下拉时能低于 0.8V 即可。当输出高电平时，忽略管子的泄电流，两输入口需 200uA，200uA x15K=3V 即上拉电阻压降为 3V，输出口可达到 2V，此阻值为最大阻值，再大就拉不到 2V 了。选 10K 可用。【最大压降 / 最大电流、最小压降 / 最小电流】
COMS 门的可参考 74HC 系列设计时管子的泄电流不可忽略，IO 口实际电流在不同电平下也是不同的，上述仅仅是事理，一句话概括为：“输出高电平时要喂饱后面的输入口，输出低电平不要把输出口喂撑了”（否则多余的电流喂给了级联的输入口，高于低电平门限值就不可靠了）
此外，还应把稳以下几点：
A、要看输出口驱动的是什么器件，如果该器件须要高电压的话，而输出口的输出电压又不足，就须要加上拉电阻。
B、如果有上拉电阻那它的端口在默认值为高电平，你要掌握它必须用低电平才能掌握如三态门电路三极管的集电极，或二极管正极去掌握把上拉电阻的电流拉下来成为低电平。反之，
C、尤其用在接口电路中，为了得到确定的电平，一样平常采取这种方法，以担保精确的电路状态，以免发生意外，比如，在电机掌握中，逆变桥高下桥臂不能直通，如果它们都用同一个单片机来驱动，必须设置初始状态。防止直通!
驱动只管即便用灌电流 . 电阻在选用时，选用经由打算后与标准值最附近的一个！
P0 为什么要上拉电阻缘故原由有：
1.P0 口片内无上拉电阻
2.P0 为 I/O 口事情状态时，上方 FET被关断，从而输出脚浮空，因此 P0 用于输出线时为开漏输出。
3. 由于片内无上拉电阻，上方 FET 又被关断，P0 输出 1 时无法拉升端口电平。
P0 是双向口，其它 P1，P2，P3 是准双向口。准双向口是由于在读外部数据时要先“准备”一下，为什么要准备一下呢？
单片机在读准双向口的端口时，先应给端口锁存器赋 1，目的是使 FET 关断，不至于因片内 FET 导通使端口胁迫在低电平。
高下拉一样平常选 10k！
